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2010-2012 Microchip Technology Inc.
DS39977F-page 165
PIC18F66K80 FAMILY
REGISTER 10-17: IPR4: PERIPHERAL INTERRUPT PRIORITY REGISTER 4
R/W-1
U-0
R/W-1
TMR4IP
EEIP
CMP2IP
CMP1IP
—
CCP5IP
CCP4IP
CCP3IP
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 7
TMR4IP:
TMR4 Overflow Interrupt Priority bit
1
= High priority
0
= Low priority
bit 6
EEIP:
EE Interrupt Priority bit
1
= High priority
0
= Low priority
bit 5
CMP2IP:
CMP2 Interrupt Priority bit
1
= High priority
0
= Low priority
bit 4
CMP1IP:
CMP1 Interrupt Priority bit
1
= High priority
0
= Low priority
bit 3
Unimplemented:
Read as ‘0’
bit 2
CCP5IP:
CCP5 Interrupt Priority bit
1
= High priority
0
= Low priority
bit 1
CCP4IP:
CCP4 Interrupt Priority bit
1
= High priority
0
= Low priority
bit
CCP3IP:
CCP3 Interrupt Priority bits
1
= High priority
0
= Low priority
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